Corsi di Laurea

[df87]

ISTRUZIONI R-TYPE
add, addu, sub, subu, mult, div, mfhi, mflo, mfcz, lwcz, slt, jr, and, or, xor, nor
ISTRUZIONI DI TIPO I
addi, addiu, andi, ori, slti, lw, lh, lhu, lb, lbu, sw, sh, sb, lui, swcz, beq, bne
{lw, lh, lhu, lb, lbu, sw, sh, sb, lui, swcz} => [lw/sw]
ISTRUZIONI DI TIPO J
j, jal

CICLO 1.ISTRUCTION FETCH
•IR <- M[PC] : MemRead , IRWrite, IorD = 0;
•PC <- PC +4 : ALuSrcA = 0, ALUSrcB = 01, ALUOp = 00, PCSource = 00, PCWrite;

CICLO 2.ISTRUCTION DECODE / REGISTER FETCH
ALUSrcA = 0, ALUSrcB = 11, ALUOp = 00;

CICLO 3.EXECUTE
• lw/sw :
ALUSrcA = 1, ALUSrcB = 10, ALUOp = 00;
• addi, addiu, slti
ALUSrcA = 1, ALUSrcB = 10, ALUOp = 10;
• add, addu, sub, subu, mult, div, and, or, xor, nor, mfhi, mflo, mfcz, lwcz, jr :
ALUSrcA = 1, ALUSrcB = 00, ALUOp = 10;
• beq, bne :
ALUSrcA = 1, ALUSrcB = 00, ALUOp = 01, PCWriteCond, PCSource = 01.
CICLO 4.
• memory access (sw)
IorD = 1, MemWrite;
• memory access (lw)
IorD = 1, MemRead;
• R-Type completion {add, addu, sub, subu, mult, div, and, or, xor, nor, mfhi, mflo, mfcz, lwcz, jr}:
MemtoReg = 0, RegDst = 1, RegWrite;
• addi, addiu, slti :
MemtoReg = 0, RegDst = 0, RegWrite;

CICLO 5. WRITE BACK STEP
• lw
MemtoReg = 1, RegDest = 0, RegWrite.

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[pimp_one]

ISTRUZIONI R-TYPE
add, addu, sub, subu, mult, div, mfhi, mflo, mfcz, lwcz, slt, jr, and, or, xor, nor
ISTRUZIONI DI TIPO I
addi, addiu, andi, ori, slti, lw, lh, lhu, lb, lbu, sw, sh, sb, lui, swcz, beq, bne
{lw, lh, lhu, lb, lbu, sw, sh, sb, lui, swcz} => [lw/sw]
ISTRUZIONI DI TIPO J
j, jal

CICLO 1.ISTRUCTION FETCH
•IR <- M[PC] : MemRead , IRWrite, IorD = 0;
•PC <- PC +4 : ALuSrcA = 0, ALUSrcB = 01, ALUOp = 00, PCSource = 00, PCWrite;

CICLO 2.ISTRUCTION DECODE / REGISTER FETCH
ALUSrcA = 0, ALUSrcB = 11, ALUOp = 00;

CICLO 3.EXECUTE
• lw/sw :
ALUSrcA = 1, ALUSrcB = 10, ALUOp = 00;
• addi, addiu, slti
ALUSrcA = 1, ALUSrcB = 10, ALUOp = 10;
• add, addu, sub, subu, mult, div, and, or, xor, nor, mfhi, mflo, mfcz, lwcz, jr :
ALUSrcA = 1, ALUSrcB = 00, ALUOp = 10;
• beq, bne :
ALUSrcA = 1, ALUSrcB = 00, ALUOp = 01, PCWriteCond, PCSource = 01.
CICLO 4.
• memory access (sw)
IorD = 1, MemWrite;
• memory access (lw)
IorD = 1, MemRead;
• R-Type completion {add, addu, sub, subu, mult, div, and, or, xor, nor, mfhi, mflo, mfcz, lwcz, jr}:
MemtoReg = 0, RegDst = 1, RegWrite;
• addi, addiu, slti :
MemtoReg = 0, RegDst = 0, RegWrite;

CICLO 5. WRITE BACK STEP
• lw
MemtoReg = 1, RegDest = 0, RegWrite.

WAAAAAAAAAAAAAAAA e sta roba dove l'hai presa? grandeeeee

[Pinturicchio]

grandissimo!!!

[kandle]

Ok non sarà originale ma non posso sottrarmi:
sei un grande!!!

ovviamente è affidabile, giusto?

[roberunix]

GRANDISSIMO DONATO

[pimp_one]

Scusate ma l'istruzione jr non dovrebbe permetterci di saltare all'istruzione con indirizzo contenuto nel registro che passiamo a jr???
Come può terminare come una add???

in merito a quest'istruzione ho mandato un'mail al prof , cmq la mia opinione è che oltre ad asserire i soliti segnali si debbano asserire anche PcSorce=00 e PcWrite

cmq attenderò la risposta dal prof e vi farò sapere

[sIlVeR]

in merito a quest'istruzione ho mandato un'mail al prof , cmq la mia opinione è che oltre ad asserire i soliti segnali si debbano asserire anche PcSorce=00 e PcWrite

cmq attenderò la risposta dal prof e vi farò sapere

e allora???

[vi]

Leggendo un po il materiale proposto, ho trovato implementazioni diverse a riguardo dell'istruzione addi.
E' corretta quella proposta sopra oppure si fa in maniera diversa?

[bobo87]

ragazzi non mi trovo con la jr $ra$ di cui sopra...che poi c'era un esercizio in cui questa istruzione veniva trattata come una j label: PcSource=10 PcWrite=1...

[KekkoB]

Ragazzi sono attendibili queste modifiche? perchè spulciando il forum ho letto che bisogna prendere con le pinze la sezione di calcolatori..

[DomenicoAngri]

La jr è un istruzione di tipo R è scritta bene..

Mi sembra attendibile questo documento, in ogni modo è solo una linea guida, la modifica del datapath deve comunque poi essere implementata da noi.. Ma può essere d'aiuto!